Слайд 2
![Двоичный сумматор Двоичный сумматор (SM) служит для формирования арифметической суммы](/_ipx/f_webp&q_80&fit_contain&s_1440x1080/imagesDir/jpg/10775/slide-1.jpg)
Двоичный сумматор
Двоичный сумматор (SM) служит для формирования арифметической суммы n-разрядных
двоичных чисел А и В. Результатом сложения (при n = 4) является четырехразрядная сумма S и выход переноса Р, который можно рассматривать как пятый разряд суммы.
Слайд 3
![Полусумматор Полусумматор (HS - HalfSum - полусумма), - это устройство,](/_ipx/f_webp&q_80&fit_contain&s_1440x1080/imagesDir/jpg/10775/slide-2.jpg)
Полусумматор
Полусумматор (HS - HalfSum - полусумма), - это устройство, производящее
сложение двух одноразрядных двоичных чисел без учета переноса предыдущего разряда.
Слайд 4
![Полусумматор](/_ipx/f_webp&q_80&fit_contain&s_1440x1080/imagesDir/jpg/10775/slide-3.jpg)
Слайд 5
![Полусумматор](/_ipx/f_webp&q_80&fit_contain&s_1440x1080/imagesDir/jpg/10775/slide-4.jpg)
Слайд 6
![Полный одноразрядный сумматор Полный одноразрядный сумматор суммирует биты соответствующих разрядов](/_ipx/f_webp&q_80&fit_contain&s_1440x1080/imagesDir/jpg/10775/slide-5.jpg)
Полный одноразрядный сумматор
Полный одноразрядный сумматор суммирует биты соответствующих разрядов двух
двоичных чисел с учетом переноса и вырабатывает перенос в следующий разряд.
Слайд 7
![Полный одноразрядный сумматор Полный одноразрядный сумматор можно построить из двух](/_ipx/f_webp&q_80&fit_contain&s_1440x1080/imagesDir/jpg/10775/slide-6.jpg)
Полный одноразрядный сумматор
Полный одноразрядный сумматор можно построить из двух полусумматоров HS
и логического элемента ИЛИ. Один полусумматор используется для сложения i-го разряда двоичных чисел, а второй полусумматор складывает результат первого полусумматора с переносом из (i-1) разряда.
Слайд 8
![Многоразрядный сумматор Для сложения двух многоразрядных двоичных чисел используют многоразрядные](/_ipx/f_webp&q_80&fit_contain&s_1440x1080/imagesDir/jpg/10775/slide-7.jpg)
Многоразрядный сумматор
Для сложения двух многоразрядных двоичных чисел используют многоразрядные сумматоры, представляющие
собой в простейшем виде последовательное соединение одноразрядных сумматоров.
Слайд 9
![Многоразрядный сумматор В корпусе микросхемы К155ИМ3 четыре полных одноразрядных сумматора объединены в схему четырехразрядного сумматора.](/_ipx/f_webp&q_80&fit_contain&s_1440x1080/imagesDir/jpg/10775/slide-8.jpg)
Многоразрядный сумматор
В корпусе микросхемы К155ИМ3 четыре полных одноразрядных сумматора объединены в
схему четырехразрядного сумматора.
Слайд 10
![Схемы вычитания Вычитание можно осуществить, инвертируя число В и суммируя полученный результат с А.](/_ipx/f_webp&q_80&fit_contain&s_1440x1080/imagesDir/jpg/10775/slide-9.jpg)
Схемы вычитания
Вычитание можно осуществить, инвертируя число В и суммируя полученный результат
с А.
Слайд 11
![Схемы вычитания При А > В получаем Р = 1.Результат](/_ipx/f_webp&q_80&fit_contain&s_1440x1080/imagesDir/jpg/10775/slide-10.jpg)
Схемы вычитания
При А > В получаем Р = 1.Результат S формируется
в прямом коде.
При A < B получаем Р = 0. Результат S формируется в обратном
Слайд 12
![При С=0 устройство работает как сумматор. При С=1 – как вычитатель.](/_ipx/f_webp&q_80&fit_contain&s_1440x1080/imagesDir/jpg/10775/slide-11.jpg)
При С=0 устройство работает как сумматор.
При С=1 – как вычитатель.
Слайд 13
![Цифровой компаратор Цифровым компаратором называют устройство, фиксирующее результат сравнения n-разрядных](/_ipx/f_webp&q_80&fit_contain&s_1440x1080/imagesDir/jpg/10775/slide-12.jpg)
Цифровой компаратор
Цифровым компаратором называют устройство, фиксирующее результат сравнения n-разрядных двоичных кодов
чисел.
Цифровой компаратор можно построить на сумматоре, подавая на один суммирующий вход прямой код числа А, на другой — инверсный код числа В.
Слайд 14
![Цифровой компаратор](/_ipx/f_webp&q_80&fit_contain&s_1440x1080/imagesDir/jpg/10775/slide-13.jpg)